唐儀科技有限公司
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Verilog/Spice netlist 轉出 Schematic, RTL 轉出 Building Block diagram 的設計輔助工具。
IC 電路ERC (electrical rule check) 分析工具。
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桃園市楊梅區桃園縣楊梅鎮永平路551號
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